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 Anonimato em sistemas de votação electrónica
Please use this identifier to cite or link to this item http://hdl.handle.net/10773/1917

title: Anonimato em sistemas de votação electrónica
authors: Almeida, Carlos Filipe Marques
advisors: Zúquete, André Ventura da Cruz Marnôto
keywords: Engenharia electrónica
Sistemas de telecomunicações
Arquitectura de redes
issue date: 2008
publisher: Universidade de Aveiro
abstract: Este trabalho descreve a concepção e realização de uma nova arquitectura para a submissão anónima de votos concebida para o sistema de votação electrónica REVS. A arquitectura é baseada no conceito dos Mix Rings, um anel de entidades que permite trocas de dados anónimas. O conceito original de anonimização de tráfego dos Mix Rings foi mantido mas a nova arquitectura, concebida para o problema concreto da submissão de votos, é diferente em múltiplos aspectos, a saber: política de construção do anel, gestão dinâmica do anel para tolerar a falha e recuperação dos seus elementos e autenticação dos elementos do anel. Um protótipo do anel de anonimização foi implementado em Java, usando Java RMI como base para a interacção remota, e foi testado em múltiplos cenários operacionais envolvendo falhas singulares ou múltiplas. ABSTRACT: This work describes the design and implementation of a new architecture for anonymous ballot submissions within REVS (Robust Electronic Voting System). The architecture is based on the Mix Rings concept, which was conceived for supporting anonymous unidirectional communications between two hosts. However, there are many differences between the original Mix Ring architecture and the one here presented; some of them deserve special attention on this work: ring construction and management for fault tolerance, which is critical in voting events, and mutual authentication of Mixes participating in the ring. To validate our architecture we implemented a prototype in Java. The communication of voters with the ring and within Mixes of the ring is implemented on top of Java RMI. Several fault scenarios were conceived and tested to assess the robustness against singular or multiple Mix failures.
description: Mestrado em Engenharia Electrónica e Telecomunicações
URI: http://hdl.handle.net/10773/1917
appears in collectionsDETI - Dissertações de mestrado
UA - Dissertações de mestrado

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